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   更新时间:2024-01-24 01:46:56     点击量:148    

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FPGA需要几个不同的低压供电轨,每个供电轨都有自己的电压和电流规格,以便为其内核逻辑、I/O电路、辅助逻辑、收发器和存储器供电。这些供电轨可能需要按特定的顺序开启和关闭,以避免损坏FPGA。负载点(POL)稳压器将电路板较高的输入电源电压降低为FPGA所需的多个输入电压。当功率转换效率至关重要时,开关稳压器可用作POL稳压器,而线性稳压器(例如低压差(LDO)稳压器)则用于噪声敏感型电路,例如PLL和收发器。

  典型的电路板输入电压为5 V、12 V、24 V和48 V,FPGA的输入电压范围则为低于1 V至约3 V。对于高输入电压(12 V、24 V、48 V),可能需要使用额外的降压稳压器来生成馈送给POL稳压器的中间总线电压(参见图1)。在FPGA供电轨中,核电压需要低的电压(约等于或低于1 V)和高的精度(&plun;3%或更优),电流电平约为几十安培,具体取决于FPGA资源的利用率。为了防止出现逻辑错误,不仅在直流条件下,而且在FPGA电流瞬态期间,电压波动都需要按照FPGA供电轨公差规格要求控制在几十毫伏之内。电源的直流精度越差,在瞬态条件下维持可用电源电压所需的旁路电容就越多。例如,假设采用&plun;3%内核电压公差规格。使用精度为&plun;1%的直流电源时,对应的瞬态公差为&plun;2%。直流电源的精度较低(&plun;2%)时,瞬态公差会更严格(&plun;1%),相比之前的示例,需要更多的旁路电容。

 

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